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[文件已评审] 编号:20170920 PCB公益评审报告

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发表于 2017-9-20 10:11:00 | 显示全部楼层
11、LCD5V应该不够,请加粗到40mil以上1 O9 W% i( L; R$ H
) u: A) @5 _9 g

0 v" S, n& Y$ c3 b
: u4 p  F* |$ x$ ?# Y+ Z
) P+ Y. s& l- a; c( @7 P; h' d

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发表于 2017-9-20 10:11:33 | 显示全部楼层
12、USB如果用于供电,那么这里这么一根线肯定也是不够的。( G7 U8 o$ L8 [0 Q! ~

1 [! N% E8 I% P9 Q! E

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发表于 2017-9-20 10:13:18 | 显示全部楼层
13、DDR部分信号 要被DDR电源全部覆盖。

3 i/ e; }# N! u$ i  j4 K! o

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发表于 2017-9-20 10:14:06 | 显示全部楼层
14、重新设置下规则,DDR电源都被割断了。
2 @. G& D% V8 ^2 l. N- v. r' a* l% t0 _; O' b

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发表于 2017-9-20 10:14:57 | 显示全部楼层
15、LOG也是大电流,这样处理不行,载留面积根本够的。

, A9 P  Z7 i/ @2 P

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发表于 2017-9-20 10:15:51 | 显示全部楼层
16、USB供电 太小了。
# t# Y0 m: \7 C" P4 E' f" @7 N+ n) _& S6 N7 ]; F/ e6 A0 O

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发表于 2017-9-20 10:16:09 | 显示全部楼层
评审建议:7 M. s7 g- y7 N) O
1:重新设定规则,铜皮采用全连接,铜皮到过孔的距离设置为52 `, R/ O* X- N! V: E7 k
2:给予主控部分,电源部分分别加屏蔽罩。
/ o; @/ x7 X$ E/ _; c1 `3:修整电源,BGA出来的LDO加大,尤其是BGA的核心电源。
! B0 t* f6 Q5 z1 R/ `4:调整DDR数据线和地址线的环路,减少环路面积,压缩DDR范围。1 ~# t2 j% v& S: U8 Z
5:压缩 DDR范围后,将垮入DDR部分的其他信号线及电源挪走。+ S+ F$ G: L, J6 N7 C
DDR部分不能有其他任何与DDR无关的信号,每层都是这样的。" t5 l: x) c6 Z' q- f
6:其他的一些问题等整改完后,在看。先把这些致命问题整改好。
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发表于 2017-9-20 17:15:41 | 显示全部楼层
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发表于 2017-9-21 14:13:40 | 显示全部楼层
- p& a; J! U" v7 E
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发表于 2017-9-22 08:25:53 | 显示全部楼层
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