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[文件已评审] 4层Allegro USB PCB论坛公益评审报告:20180829

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发表于 2018-8-29 18:01:18 | 显示全部楼层 |阅读模式
本帖最后由 bonsoir 于 2018-8-29 18:22 编辑 # q! n( J# g& G& A; g2 m3 v7 O
% z% I$ E# H+ _8 b9 E; F
您阅读的评审报告自于凡亿PCB QA评审组(www.fany-online.com) - \( j. m6 G; U
------------------------------------------------------------------------------------
. d; {* }! y' Z; F  E1 Y" T2 G使用前请您先阅读以下条款:
' R" r9 x9 j. |6 C8 v, k1.评审PCB全程保密不外发,评审之后会进行文件删除,介意者不要发送文档!
. Q4 ^) \5 x) s2.评审报告只是局部截图并添加文字说明,如需更详细的请内容请联系我们评审人员3 e& Y3 o) ]3 d3 v4 W! k5 k
3.评审意见仅供参考意见,由此造成的任何相关损失网站概不负责( _- {  Y  @; o; \" u+ G& ]  ~
------------------------------------------------------------------------------------)
& H9 {: }1 J4 q! ]! g如果您的PCB需要评审,请以邮件的方式发送给我们,我们一般在1个工作日之内安排评审
5 N$ E* O7 Y+ I7 `4 Z5 ~邮件格式:PCB公益评审+项目名称- L: u5 U2 E5 Y7 ^
邮件地址:pcbqa@fany-eda.com
/ F0 h2 ?0 y8 B/ W- K. V7 j; s7 F0 Z, b, z' G2 c
5 X" Y0 b) k' n4 M' B* r2 M
1、usb差分线打孔换层,建议旁边打一个回流地孔9 A, w- A/ B5 u$ ]4 I

* h+ L" p1 B; O" |- ]) p3 I8 p5 Z( k

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发表于 2018-8-29 18:14:51 | 显示全部楼层
5、晶振摆放位置错误,建议这样摆放
: N  A  v2 f# @* A/ s! B- P: v  `9 I) c; m4 z6 t4 V
& P# R; D) |' _, P3 c
2 R: S' S, s1 T- b! I0 ^4 p; m9 l. p1 a
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发表于 2018-8-29 18:06:10 | 显示全部楼层
2、r1和r2建议靠近usb座子摆放
2 |# V2 M: u! I# q
, y% s1 a% Z6 s
, u9 h7 {+ F$ Q4 b5 W* w; c

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发表于 2018-8-29 18:07:17 | 显示全部楼层
3、r1和r2要设置xnet,芯片这边走线也要设置差分规则走线3 [- G% V# m! L# k! l' V( [

/ D: l$ Y' v+ C7 V/ Y
* D1 s+ z  i) v9 L& `

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发表于 2018-8-29 18:09:18 | 显示全部楼层
4、建议不要从PIN之间走线,影响贴片
6 N8 [/ t% |' h9 K9 t& N
; k: h, j" V2 S! Q6 K$ n" t8 y  B% K5 j

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发表于 2018-8-29 18:17:56 | 显示全部楼层
6、复位信号建议加粗到10mil
5 g2 s1 I" @) Z" Q1 m! T$ P9 K6 M! U- ?2 b

' ?: v3 l) u  _/ |* T3 e1 ]  V

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发表于 2018-8-29 18:19:12 | 显示全部楼层
7、电源加粗
( X/ L& }$ a3 ^5 ~. J8 o
& m- D) s2 l9 \5 o' Q3 [9 g
4 l$ r: v+ q& O( H7 [

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发表于 2018-8-29 18:20:35 | 显示全部楼层
8、电源和地线建议加粗到15mil以上. @4 \$ `! q, S
" y0 W- D* p' N1 P

& {: a* c0 p" A; u" E0 u
0 O, h! i  w7 C) a

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发表于 2018-8-30 09:29:26 | 显示全部楼层
谢谢分享,好评审,学习了
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发表于 2018-8-30 09:29:41 | 显示全部楼层
谢谢分享,好评审,学习了
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