AD 4层pcb板 PCB论坛公益评审报告：20181113

凡亿刘老师

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5 u  P; N. @! F: G  }& l[size=12.0000pt]1. [size=12.0000pt]过孔没盖油，建议进行盖油处理。
   

[size=12.0000pt]2. [size=12.0000pt]DRC检查，存在错误。违反了电源层的连接规则。（可能是AD版本不同导致规则没有导过来，但还是建议检查下。）
   

[size=12.0000pt]3.类似于此种孤岛铜和尖角铜，建议割掉。电容电阻中的铜也要割掉。
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[size=12.0000pt]4.电源的分割线一般用15mil的。图中的分割存在瓶颈，中间的太窄了。
' }2 i. `3 Z- E8 w1 P5 z0 C
$ M9 U4 ]/ j  X; @% z; a[size=12.0000pt]5. [size=12.0000pt]过孔的间距太小，造成平面割裂了。建议拉大间距，或者修改规则。
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# n! a9 _; w; D9 a* Y, b  b2 I[size=12.0000pt]6.出线建议从焊盘中心出。
7 p+ K* M# i' @! K, A# E' o5 N
) r" V+ P4 C+ C! U1 O. ~& x) }, z[size=12.0000pt]7.线宽不能超过焊盘，建议引出后加粗。
2 X* }1 A+ V5 j  C
[size=12.0000pt]8.焊盘间不要这样连接，影响工艺。
# S! \7 F! ]3 w) X
- E. X7 `& z! A+ K6 Z& }3 E[size=12.0000pt]9. [size=12.0000pt]走线时，不要出现直角和锐角。
2 y) V" B: w: u* h8 B% _' u4 L
[size=12.0000pt]10. [size=12.0000pt]UDB此对信号应为差分信号。

' X8 w" B0 U6 k3 c6 W/ |3 k+ [[size=12.0000pt]11. [size=12.0000pt]X2是晶振，走线要考虑π型滤波，包地，且下方不能穿线。

[size=12.0000pt]12. [size=12.0000pt]CPU中不建议这样穿线，影响工艺，地孔可打孔通过地铜连接。
/ q/ J+ Z9 t6 B* f2 ]
[size=12.0000pt]13. [size=12.0000pt]走线时，能拉直尽量拉直。

3 w' Y( T, w0 a  P6 Q[size=12.0000pt]14. [size=12.0000pt]电源的处理。
' L' A# x2 m! F/ }[size=12.0000pt]电源的处理参考经验值0.5mm的过孔过1A。表层的线是40mil过1A（表层递增加20，内层递增加40 。不是绝对值，通常做好1A的预留）。检查电源的过孔数量是否足够，线宽是否满足需要。


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zhidai

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