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[文件已评审] AD 4层采集器 PCB论坛公益评审报告:20181120

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发表于 2018-11-20 16:07:35 | 显示全部楼层 |阅读模式
[size=12.0000pt]1过孔开窗了,建议进行盖油处理。
9 O4 D3 e, r/ ?( g% b0 D
" S( }& b' k, g" y* O$ A6 M1 V[size=12.0000pt]2. [size=12.0000pt]DRC检查,存在报错。热焊盘设计不符合设置规则,会影响焊接。需要调整设计规则或更改设计。
, g: N# `/ R) K& v6 x1 {( i. R. p7 h2 X) k
[size=12.0000pt]3. [size=12.0000pt]尖角铜皮,孤岛铜皮和电容电阻器件间的铜皮,建议割掉。2 {1 O. U4 Q5 b# f
$ }! X. o  d1 p: v6 E2 O6 T- U1 j& n
[size=12.0000pt]4.AGND顶底层的铜皮没区分开来,与PGND一样,可以在顶底层连接,地层尽量保持完整性。
, ?( p: C% I; W% j6 V/ C3 L/ P5 B) _+ W! _# h5 j+ N
[size=12.0000pt]5.电源层割裂严重,且出现瓶颈。建议小电源顶底层处理,大电源电源层处理,保持平面完整。- J* I! a& w* V( v
4 F/ X8 [, P6 ]* e& E7 S
3 J( g' u3 w& w9 E; m- E

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发表于 2018-11-20 16:09:04 | 显示全部楼层
[size=12.0000pt]6.这块是不是高压部分,如果是的话,不要铺铜。
6 j0 @+ [( K" ?/ c; C6 T1 |5 J( |: `/ h: I" s/ ?: s8 P% G: g: D4 |1 u
[size=12.0000pt]7.晶振与其电容要同层放置,且考虑π型滤波。靠近管脚摆放,下方不能过线。4 m! A7 J! S4 Y/ x1 Z

; j5 ?9 x$ Z8 O# H4 r( P[size=12.0000pt]8. [size=12.0000pt]线能拉直的就拉直,且不要存在stub线。建议修改。
  X* j5 J! R9 l& ]& x! y" I: w9 r) t
[size=12.0000pt]9. [size=12.0000pt]CPU中间不建议这样拉长线,建议修改。4 e  b+ @2 y2 N2 r$ s8 b) ~

, b6 ~0 \( Z, m$ W) M7 v[size=12.0000pt]10. [size=12.0000pt]滤波电容靠近管脚摆放,不然起不到滤波效果。
- J1 d) X' J$ Q# A4 M% P# ~4 k4 h0 n* `

8 ^6 |# q' l( A* b1 g

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发表于 2018-11-20 16:10:36 | 显示全部楼层
[size=12.0000pt]11.[size=12.0000pt]这种大焊盘建议打上散热过孔。5 |' p( N- ^) @! Y3 y- D( x

0 N. X( f* D0 X1 y3 O% v' D[size=12.0000pt]12.走线建议不要出现锐角。可以在画完板后加上泪滴。
0 @# o" v0 F+ `2 M$ M3 L3 ]( T4 ~6 |- h0 l
[size=12.0000pt]13.时钟线建议包地处理。) p) P& r7 i4 Y) V0 _$ I3 G

) Y* n' j* s/ s& i  k: p[size=12.0000pt]14.由于没原理图,不知道电流多大。电源的处理建议参考经验值0.5mm的过孔过1A。表层的线是40mil过1A(表层递增加20,内层递增加40 。不是绝对值,通常做好1A的预留)。检查电源的过孔数量是否足够,线宽是否满足需要。+ A8 R7 M' i) q7 w- {
  M( L8 @, A8 U6 [7 H: u; G6 S

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发表于 2018-11-20 18:59:13 | 显示全部楼层
谢谢分享AD 4层采集器 PCB论坛公益评审
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发表于 2019-1-22 15:43:24 | 显示全部楼层
要是每个都有个正确的示例,看看会更好
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发表于 2019-1-23 14:42:44 | 显示全部楼层
谢谢分享,学习了
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发表于 2019-1-23 20:38:49 | 显示全部楼层
学习学习,
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发表于 2019-3-28 13:54:03 | 显示全部楼层
时钟线包地处理有没有必要?间距足够应该就可以了
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发表于 2019-8-26 10:32:00 | 显示全部楼层
感谢分享,积累学习
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发表于 2020-11-26 16:14:17 | 显示全部楼层
谢谢分享,学习一下
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