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[文件已评审] AD 4层采集器 PCB论坛公益评审报告:20181120

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发表于 2018-11-20 16:07:35 | 显示全部楼层 |阅读模式
[size=12.0000pt]1过孔开窗了,建议进行盖油处理。3 ~# u; O1 \# J. Q2 u$ F3 U& v

# Y  z$ v8 R8 n" Y5 x' v/ s[size=12.0000pt]2. [size=12.0000pt]DRC检查,存在报错。热焊盘设计不符合设置规则,会影响焊接。需要调整设计规则或更改设计。) O: {3 r- E% ^6 M, k
. }4 S2 F! M  B4 H- u( R5 r0 n
[size=12.0000pt]3. [size=12.0000pt]尖角铜皮,孤岛铜皮和电容电阻器件间的铜皮,建议割掉。/ g! g' O9 T" T% ~: ~

6 @. T. _& k+ ^6 w2 Y( L[size=12.0000pt]4.AGND顶底层的铜皮没区分开来,与PGND一样,可以在顶底层连接,地层尽量保持完整性。
6 ]8 F" }' _; @0 n5 m& ^
/ [- q  A7 j+ Z7 Z, R5 C% a: e[size=12.0000pt]5.电源层割裂严重,且出现瓶颈。建议小电源顶底层处理,大电源电源层处理,保持平面完整。& H& q" u) R0 O# w+ o& y! I7 \5 A) \

: K: q" _  J6 e: w2 Q+ N8 Q) b7 P

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发表于 2018-11-20 16:09:04 | 显示全部楼层
[size=12.0000pt]6.这块是不是高压部分,如果是的话,不要铺铜。# [3 W1 c& {5 `

0 ?1 p5 N0 y/ y( T- `7 s9 z- A[size=12.0000pt]7.晶振与其电容要同层放置,且考虑π型滤波。靠近管脚摆放,下方不能过线。
8 c1 k' O, E. e& A% |! @& B
8 k  j8 C, k4 Y. t" ?, ?[size=12.0000pt]8. [size=12.0000pt]线能拉直的就拉直,且不要存在stub线。建议修改。0 {* F: z8 U$ v

% Q0 H' D9 Z+ w" |+ {[size=12.0000pt]9. [size=12.0000pt]CPU中间不建议这样拉长线,建议修改。
! l- l4 ]7 y, x( Z, k3 k# y0 f, V% d( Q* j
[size=12.0000pt]10. [size=12.0000pt]滤波电容靠近管脚摆放,不然起不到滤波效果。
) v$ t0 Y; z( T0 {, V' u6 ]! C/ U% ^9 Y9 o6 o" ?9 R2 c1 e

3 M( e4 s# [: z

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发表于 2018-11-20 16:10:36 | 显示全部楼层
[size=12.0000pt]11.[size=12.0000pt]这种大焊盘建议打上散热过孔。
, G# y: T9 [& B1 n2 \! S/ \( k4 K2 p7 c$ l% r9 F
[size=12.0000pt]12.走线建议不要出现锐角。可以在画完板后加上泪滴。; x: J7 h$ b# K9 I) j* g
$ m2 Y& f) i1 a$ [; L
[size=12.0000pt]13.时钟线建议包地处理。) V; N/ Z1 K1 [; g+ _0 l; c

( [% L3 k3 B* S. F' U  H6 \: R! U[size=12.0000pt]14.由于没原理图,不知道电流多大。电源的处理建议参考经验值0.5mm的过孔过1A。表层的线是40mil过1A(表层递增加20,内层递增加40 。不是绝对值,通常做好1A的预留)。检查电源的过孔数量是否足够,线宽是否满足需要。
; ]* ~3 W) g! s+ [* i+ W
  L* r# U/ A' k2 h. R

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发表于 2018-11-20 18:59:13 | 显示全部楼层
谢谢分享AD 4层采集器 PCB论坛公益评审
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发表于 2019-1-22 15:43:24 | 显示全部楼层
要是每个都有个正确的示例,看看会更好
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发表于 2019-1-23 14:42:44 | 显示全部楼层
谢谢分享,学习了
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发表于 2019-1-23 20:38:49 | 显示全部楼层
学习学习,
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发表于 2019-3-28 13:54:03 | 显示全部楼层
时钟线包地处理有没有必要?间距足够应该就可以了
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发表于 2019-8-26 10:32:00 | 显示全部楼层
感谢分享,积累学习
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发表于 2020-11-26 16:14:17 | 显示全部楼层
谢谢分享,学习一下
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