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[文件已评审] AD 4层采集器 PCB论坛公益评审报告:20181120

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发表于 2018-11-20 16:07:35 | 显示全部楼层 |阅读模式
[size=12.0000pt]1过孔开窗了,建议进行盖油处理。
: T; _1 L4 W- D! E& {% r1 D* V8 j, V6 o: R, H( d( I$ }  S
[size=12.0000pt]2. [size=12.0000pt]DRC检查,存在报错。热焊盘设计不符合设置规则,会影响焊接。需要调整设计规则或更改设计。9 {% X, _! P" q' A$ m! g/ @

* c4 k! Z& M( s3 U7 D( G[size=12.0000pt]3. [size=12.0000pt]尖角铜皮,孤岛铜皮和电容电阻器件间的铜皮,建议割掉。" J$ ]7 w9 X4 y" Y3 l: g! Z. h
+ Z) N1 l9 R& U
[size=12.0000pt]4.AGND顶底层的铜皮没区分开来,与PGND一样,可以在顶底层连接,地层尽量保持完整性。
9 D! E" d9 u3 X& ]0 |; Y: S4 f& y- w
[size=12.0000pt]5.电源层割裂严重,且出现瓶颈。建议小电源顶底层处理,大电源电源层处理,保持平面完整。( @7 Z% J. G. h0 m. h

. a' q0 q1 [/ g" t/ w6 c. @3 K
# m" x3 ~' Y* F7 U  P

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发表于 2018-11-20 16:09:04 | 显示全部楼层
[size=12.0000pt]6.这块是不是高压部分,如果是的话,不要铺铜。
$ ^* T" {: }- @. A1 }& L: n- B0 _8 o; W1 C$ p6 {' R1 g
[size=12.0000pt]7.晶振与其电容要同层放置,且考虑π型滤波。靠近管脚摆放,下方不能过线。  i* c+ {! L8 I( i7 S3 {5 m
1 u" h/ j) H& q0 A
[size=12.0000pt]8. [size=12.0000pt]线能拉直的就拉直,且不要存在stub线。建议修改。0 d3 x. n4 J6 k7 ?
$ A6 a% N7 x; C$ a# @
[size=12.0000pt]9. [size=12.0000pt]CPU中间不建议这样拉长线,建议修改。: |, o7 x- Z- }3 I# i6 ]) b" ~
8 G8 T* Q* n2 N: K% @# J& W
[size=12.0000pt]10. [size=12.0000pt]滤波电容靠近管脚摆放,不然起不到滤波效果。% P6 Y; x. W7 L* m6 x/ ]
% ?) h9 H/ V# A' v+ _8 r

7 o* h4 E! y! t1 V( O6 B: {

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发表于 2018-11-20 16:10:36 | 显示全部楼层
[size=12.0000pt]11.[size=12.0000pt]这种大焊盘建议打上散热过孔。2 k! w( b5 \0 Z1 x0 J2 R

1 X) u1 V5 x. |- |5 T[size=12.0000pt]12.走线建议不要出现锐角。可以在画完板后加上泪滴。
' G3 y) P  a: O5 R$ _
, n% K( }: ], u* {9 U; R9 a, d9 w/ Z[size=12.0000pt]13.时钟线建议包地处理。
7 ?! Y9 Q2 W  a6 w9 \% |
& G' `4 D% }% {+ B* @* U2 z[size=12.0000pt]14.由于没原理图,不知道电流多大。电源的处理建议参考经验值0.5mm的过孔过1A。表层的线是40mil过1A(表层递增加20,内层递增加40 。不是绝对值,通常做好1A的预留)。检查电源的过孔数量是否足够,线宽是否满足需要。8 z7 `' w! E1 k: ~

" j7 S7 C( k; n- Y  A( C9 b

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发表于 2018-11-20 18:59:13 | 显示全部楼层
谢谢分享AD 4层采集器 PCB论坛公益评审
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发表于 2019-1-22 15:43:24 | 显示全部楼层
要是每个都有个正确的示例,看看会更好
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发表于 2019-1-23 14:42:44 | 显示全部楼层
谢谢分享,学习了
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发表于 2019-1-23 20:38:49 | 显示全部楼层
学习学习,
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发表于 2019-3-28 13:54:03 | 显示全部楼层
时钟线包地处理有没有必要?间距足够应该就可以了
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发表于 2019-8-26 10:32:00 | 显示全部楼层
感谢分享,积累学习
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发表于 2020-11-26 16:14:17 | 显示全部楼层
谢谢分享,学习一下
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