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[作业已审核] SDRAM T型拓扑

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发表于 2019-6-3 10:21:19 | 显示全部楼层 |阅读模式
T型拓扑等长,感觉拉线很难花的时间很多,没能总结出结论,郑老师可以帮我把思路总结下么。
QQ图片20190603102051.png

SDRAM 01.PcbDoc

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发表于 2019-6-3 20:21:08 | 显示全部楼层
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GAP间距 太小  不满足3W原则,
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发表于 2019-6-3 20:21:49 | 显示全部楼层
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走线形似 直角了,请优化走线  按照钝角进行走线 不然走线信号的反射比较严重
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发表于 2019-6-3 20:22:44 | 显示全部楼层
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等长和等长走线之间 尽量满足咬合等长的方式,这样不至于浪费空间

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发表于 2019-6-3 20:23:16 | 显示全部楼层
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平面规则没有去设置  请设置为过孔全连接吧
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发表于 2019-6-3 20:23:58 | 显示全部楼层
底层等长做得很好 ,内层应该也要按照这样来啊
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发表于 2019-6-3 20:25:07 | 显示全部楼层
相邻信号层 注意错开  从横截面看 就是两根走线很近的走线,,容易产生串扰,请更新
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发表于 2019-6-4 16:09:21 | 显示全部楼层
学习了~~~~~~
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