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[作业已审核] 弟子计划学员 龙万宝 DDR3作业

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发表于 2019-6-28 14:59:13 | 显示全部楼层 |阅读模式
1、采取T点拓扑,4片顶底对贴。2、地址线等长误差100mil,差分对最大误差5mil.
3、数据线组内等长50mil,组与组之间等长150mil。

捕获.JPG

DDR3 X4.PcbDoc

1.86 MB, 下载次数: 8, 下载积分: 联盟币 -5

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发表于 2019-6-29 14:26:09 | 显示全部楼层
-08:00C309联盟网8835.png

vref电源走线是电源  需要进行加粗 一般推荐15mil
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发表于 2019-6-29 14:27:09 | 显示全部楼层
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4片顶底贴的DDR  这个区域是底层的DDR  不能把电容放置这个区域
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发表于 2019-6-29 14:28:29 | 显示全部楼层
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过孔盖油 有些常规性的设计要求 在设计的时候请注意
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发表于 2019-6-29 14:36:29 | 显示全部楼层
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相邻走线层注意 不要重合 从横截面看就是艰苦太近 容易导致串扰
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发表于 2019-6-29 14:37:18 | 显示全部楼层
其他没问题 可以进行下面的接口模块的学习了
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发表于 2019-6-29 14:48:57 | 显示全部楼层
郑振宇_Kivy 发表于 2019-6-29 14:37
其他没问题 可以进行下面的接口模块的学习了

好的,老师,那把下一个模块的资料发给我一下呗
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