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丫丫的灰机

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发表于 2019-9-6 11:41:17 | 显示全部楼层 |阅读模式

工业和信息化部教育与考试中心-电子工程师证书（PCB设计、硬件设计、嵌入式设计），认证报考通道→→点击立即报名

这一次的layout布线占用的时间是最多的，要保证时序的一致性就得做等长处理

第四次作业.rar

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Kivy

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元始天尊

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发表于 2019-9-9 13:51:38 | 显示全部楼层

-08:00C285联盟网3539..png

这类空间如果能够更加合理的利用就最好了

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发表于 2019-9-9 13:52:17 | 显示全部楼层

-08:00C286联盟网4268..png

只有一个点的碎铜直接删除就可以

-08:00C286联盟网1359..png

-08:00C286联盟网1359..png

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发表于 2019-9-9 13:53:31 | 显示全部楼层

-08:00C286联盟网5220..png

实际载流通道请重视

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发表于 2019-9-9 13:55:01 | 显示全部楼层

-08:00C287联盟网3666..png

GND 可以通过挪孔或者挪线进行贯通可以优化下

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