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[PCB技术] 等长

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发表于 2019-9-24 14:14:34 | 显示全部楼层 |阅读模式
在布线完成后,这里以SDRAM为例,要对SDRAM信号线进行等长处理,以满足时序要求。SDRAM的信号可分为数据线、地址线、控制线、时钟线,走线时要同组同层,间距满足3W原则,每组数据线的等长误差范围为+-50mil,地址线、控制线、时钟线的等长误差范围为+-100mil。







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我就是想学习学习
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发表于 2019-9-27 19:03:53 | 显示全部楼层
谢谢楼主分享
我的路,我的人生,花开花落,一世繁华。。。
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