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[作业已审核] 8层DDR3——4片T点拓扑作业-黄玉梁

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发表于 2020-3-10 22:27:12 | 显示全部楼层 |阅读模式
本帖最后由 cesc 于 2020-3-11 14:17 编辑

黄老师,附件是我的8层DDR3 4片 T点拓扑作业,请审核。

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962.42 KB, 下载次数: 23, 下载积分: 联盟币 -5

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发表于 2020-3-11 14:03:19 | 显示全部楼层
整板铺铜以后,空白的地方间隔150-200mil打一些地过孔
+08:00C293联盟网9043..png
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发表于 2020-3-11 14:06:03 | 显示全部楼层
不同组的信号之间拉开间距,不要靠的太近
+08:00C295联盟网4581..png
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发表于 2020-3-11 14:07:11 | 显示全部楼层
走线尽量不要留这么大的空隙,均匀走线,满足3W的间距
+08:00C296联盟网9254..png
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发表于 2020-3-11 14:10:31 | 显示全部楼层
走线不能有的粗有的细,统一按阻抗线宽走线,BGA区域不好出线,可以变细一点点 +08:00C298联盟网2201..png
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发表于 2020-3-11 14:14:59 | 显示全部楼层
数据信号也是一样,保证线宽是一致的,然后走线之间需要满足3W间距
+08:00C302联盟网6225..png
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发表于 2020-3-11 14:15:42 | 显示全部楼层
走线都是这样的问题,需要重新走线
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发表于 2020-3-11 14:15:47 | 显示全部楼层
其它问题不大
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