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[作业已审核] EZ4-一片SDRAM模块练习

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发表于 2020-4-9 19:54:56 | 显示全部楼层 |阅读模式
一片SDRAM模块练习

SDRAM练习.PcbDoc

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发表于 2020-4-13 14:49:30 | 显示全部楼层
-08:00C325联盟网1757..png

走线和走线之间尽量避免大面积范围的空间
就可以吧走线进行调整下  后期铺铜的时候可以铺进去

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发表于 2020-4-13 14:50:32 | 显示全部楼层
-08:00C326联盟网1114..png

底层的线条 没有进行删除

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发表于 2020-4-13 14:50:57 | 显示全部楼层
其他没啥问题了
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发表于 2020-4-14 17:50:38 | 显示全部楼层
模块心得:1 BGA扇孔前期工作要做好不然无法扇出孔,如要测量BGA孔之间的间距从而决定打多大的过孔,模块里0.8mm间距我选择了8/16的过孔 其实过孔也可以选择较大一些的过孔,只是习惯性BGA用8/16的过孔,间距设置了5个mil,线宽按照50om的线设置 2 SDRAM中心到BGA的bank中心之间相隔600-800mil,有排阻 800-1000mil 3信号串阻要选好之间位置 4 SDRAM和串阻也要扇孔,SDRAM要寻找合适的扇孔方向 5 相邻层都是走线要错开位置不能重叠 6走线前要做好信号线的分类,数据组D0-D15 DQM 为一类,地址线,控制线,时钟线归为一类 7走线时D0-D7+DQM0为一组数据走线 D8-D15+DQM1为一组数据走线  一组数据走线必须同层 且要做等长 误差为100mil,;地址线,时钟线,控制线可以不用所有都在同一层 误差控制在200mil 7 数据线和控制、时钟、地址线要远离
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