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[作业已审核] 吴俊洪-8层DDR3 4片菊花链拓扑PCB作业

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梦旅人 发表于 2020-6-29 15:33:39 | 显示全部楼层 |阅读模式 打印 上一主题 下一主题
本帖最后由 cesc 于 2020-7-6 09:57 编辑

请黄老师审阅

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lutigers 发表于 2020-6-30 12:10:32 | 显示全部楼层
顶………………
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cesc 发表于 前天 09:51 | 显示全部楼层
不同组的信号线之间尽量间距拉大一些,或者用地线进行隔离

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cesc 发表于 前天 09:52 | 显示全部楼层
这种走线还可以均匀一些

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cesc 发表于 前天 09:54 | 显示全部楼层
这种要就近打地过孔,不能直接铺铜连上了事

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cesc 发表于 前天 09:55 | 显示全部楼层
过孔不要打在焊盘上

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cesc 发表于 前天 09:56 | 显示全部楼层
铺铜走线直接挨着板边,太近了,routekeepin要比板框内缩20mil

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cesc 发表于 前天 09:57 | 显示全部楼层
其它没什么问题
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