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（1）ERC报告管脚没有接入信号：3 f) r' V4 y: ]: o. Y4 o/ {) o8 v
3 j9 A1 f+ w6 S. va. 创建封装时给管脚定义了I/O属性；
7 @+ W+ u7 Z! t
4 l8 L8 b9 ~' T3 vb.创建元件或放置元件时修改了不一致的grid属性，管脚与线没有连上；
5 C8 C; \* q0 N2 ^( H
, @, P1 [4 i3 V& g( yc. 创建元件时pin方向反向，必须非pin name端连线。! R$ M1 s: `9 T# l8 p$ i+ K/ a
! W, }, y, O5 {3 ]2 W; ad.而最常见的原因，是没有建立工程文件，这是初学者最容易犯的错误。
8 W, I7 l! s7 N. w" P% E# x# \7 {& e/ j/ H, v" o4 |2 \
2）元件跑到图纸界外：没有在元件库图表纸中心创建元件。
1 ~4 L% Z& y: `7 \! c4 Y* r% U: g1 V$ e7 c
3）创建的工程文件网络表只能部分调入pcb：生成netlist时没有选择为global。8 g- H _0 X; j
7 K9 H; T2 O' H, Z6 k4）当使用自己创建的多部分组成的元件时，千万不要使用annotate.) T. U- H. W9 j6 X' D& j( K
3 A' n) `5 U- k( n2
W8 y" w3 n4 C; `; n; i2 Y1 Y: \3 p$ ^" _! H/ ~- j: b; l& C i
PCB常见错误
$ d4 @4 a& z8 u3 U, N. [) t* k9 k6 i& ~7 k, z+ }+ I3 I
（1）网络载入时报告NODE没有找到
$ S7 [4 z4 B) z3 Y6 R0 C e* H2 z, o$ A6 P5 F8 Y: H6 e( L
a. 原理图中的元件使用了pcb库中没有的封装； r) p+ `: |/ x% ~
" }6 ~# T5 |6 x6 ~b. 原理图中的元件使用了pcb库中名称不一致的封装；
9 a* h9 i# S8 X; J3 g3 f/ z5 T9 T3 [
c. 原理图中的元件使用了pcb库中pin number不一致的封装。. O0 G6 J2 R0 N* S* T
" | X2 u) s" ?7 u- H$ ~, p, U
如三极管：sch中pin number 为e,b,c, 而pcb中为1，2，3。
' V2 O# F& [- O+ A
; U, S: n1 Y$ O6 Y- N （2）打印时总是不能打印到一页纸上9 @! F% |- o/ H! w( ?
/ e$ ^( i8 b3 U" p- b4 n* C9 q a. 创建pcb库时没有在原点；
0 w! V a4 c W, q Z( z) w2 V; Y4 E. p; g1 h7 @+ G+ Z, l
b. 多次移动和旋转了元件，pcb板界外有隐藏的字符。选择显示所有隐藏的字符，缩小pcb, 然后移动字符到边界内。7 ]$ V0 e* o4 H0 T
" f& G9 \' Q7 i; }
（3）DRC报告网络被分成几个部分：6 p& S( b$ O6 |/ p# g* ?6 m% ^2 S# A+ [
# m0 W6 ^ G0 B% O4 ]" o6 J 表示这个网络没有连通，看报告文件，使用选择CONNECTED COPPER查找。
: y+ Y7 h- y# L5 Y5 q4 W2 O) ?1 I$ ]; F
如果作较复杂得设计，尽量不要使用自动布线。
' R% N* v/ ]% v/ G, ]- x
2 K4 ?) J, D3 K& n, {9 p3 U3 L3 U* L, C; H
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