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[作业已审核] AD53吴昌强 1片SDRAM的PCB设计

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发表于 2020-12-17 14:10:50 | 显示全部楼层 |阅读模式
心得:
1、信号线、地址线、时钟线、控制线要求特性阻抗50OM;
2、每组数据线要求同层布线;
3、线距要满足15mil(3W以上);
4、相邻层走线不能重叠;
5、地址线与数据线应该用地线隔开;
6、每组线应控制误差在100mil;

AD53吴昌强 1片SDRAM的PCB设计.zip

612.06 KB, 下载次数: 7, 下载积分: 联盟币 -5

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发表于 2020-12-19 09:07:16 | 显示全部楼层
没什么问题,等长时注意3W间距,控制好误差就可以。
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