Altium designer (AD 20) 请教关于内电层被过孔打断的问题

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请问AD软件中有没有检查内电层可能被过孔打断的规则？
比如内电层连接最窄处不能小于某个值？
: Q7 P3 f" t6 T9 J( g) @( f5 ]
: O+ o8 J; ]9 Q: a
. d5 n% A7 C( c: K: N) q( P3 C又或者可是使用多个规则的共同约束实现这种错误类型的检查？
% R5 v7 T% Y6 `/ X4 C
- }& \/ T) W7 p$ F我现在遇到的问题是，内电层还连着一点点（不到 5mil），AD没有检查出来！
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4 S, v( v0 t( Y* d6 T) N' Q希望各位前辈能帮帮忙！谢谢各位前辈！