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本帖最后由 凡人1900 于 2023-7-11 18:38 编辑
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# X+ Q: g/ i A0 C" e: w5 L$ q2 v$ N3 b" |0 y2 z+ t. Z$ _# P
9 O, t) d: Z/ |0 @
0 }9 p. m* }: O' a
) l& k4 x" w3 Z3 qAltium designer19使用几个疑问之五(一直用pads,知道的不吝赐教,谢谢。不愿意说的烦请绕道)一张张图片上传太浪费时间,就压缩了一个包了,我的疑问都在里面,图文并茂,下载解压很快
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1.绿色的边框怎么比板框都大更边缘* w' |; Y/ N" k# N- g% ]! F
( v; m: e+ V6 L+ }& c8 g( p; p2.PCB高亮网络之后原理图不会同步高亮1 O0 M- q0 q6 g* C
/ ~8 ]2 v! K4 v3.差分等长设置 右下角那个5mil值是什么含义
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8 e( q+ r8 K2 ^" _3 n4.差分等长设置对不对?. S$ F" ?( |. ~8 \: D& V% F
|: V) O6 C2 I u5.差分线线宽已经调细了,只有5mil 但是拉出来的线还是不美观也不符合要求. P, W2 o. D$ a" ]% d( z8 ~
$ p- z3 N* M1 t6 j: G) V6.画等长用的是这个菜单工具
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" C5 ~6 |# U7 F6 ^5 M- Y7.已经设置好了差分线规则+ Q( E! M( g1 r/ _1 P) J! f
( g5 Q; y( x$ E0 p( c7 J! R8.这差分线怎么画的那么别扭,我看一画基本是成为这种是大概率1 Z4 C6 b! \# m& _* Y/ a9 T
7 A _8 ?7 g7 J( f8 ?9.这种差分走线也不美观( } Y6 o" X; p8 E
+ x6 q( |6 S* d10.最开始的时候线宽较宽,这种差分线也是不对的
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11.原理图网络标号和差分对的名称label值保持一致update才不会报错?操作的时: `! L1 j+ W3 N
& @ R4 }) M% O0 C8 b' A候确实是那样,如果网络名和差分的Lable名称不一样,就会报错
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. l% h. Y0 {$ f5 o- K- V8 ~0 l12.选择位号 按AP 放不到想要的位置' }- |, {+ }) J. r
* F% V7 @8 [, I3 T' O4 b! R1 n+ q13.隐形的透明框是过孔的什么框?是怎么设置的?如果删除 所有的过孔都没了
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9 L' s c+ J7 q: z5 u/ Y" ?14.AD很容易把元件删了 有没有像pads的开关 没有关闭DRC是不可能删掉元件的。在哪里可以设置2 K) q! @ s% v3 `8 g
' P, }, t' @, h: B: y
15.考虑空间不够 就把线宽设细了 如图是最终的规则设置 E3 [" _9 A- }6 L4 L
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差分线+等长线参考这个帖子画的
: t0 R: q# }. P$ b6 B: p T, \6 p/ E$ Q' A, Y
https://blog.csdn.net/qq_36720691/article/details/124870440
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8 i2 [5 _8 W% b' l" q. e4 G7 t" `- l% U! w J9 p& n1 d
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