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[作业已审核] 张富祥——两片DDR的pcb设计作业

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发表于 2024-4-2 22:46:09 | 显示全部楼层 |阅读模式
本帖最后由 cesc 于 2024-4-3 14:03 编辑

心得:

       这次我在做地址线的扇出时,一开始不这道怎么扇出,这块我做的很不好,慢,bga的扇出我需要尽快提升自己的速度,积累经验,这次我在区域规则的设置上遇到了一点问题,但是是自己的粗心大意导致的,以后要注意,这个模块我做的很慢,得亏有黄老师和群里的一些老师,及时帮助我解决一些问题,我很感谢你们,这次设计的感觉不是很理想,但也确实学到了很多。

ddr.zip

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发表于 2024-4-3 14:02:33 | 显示全部楼层
以后做的时候,尽量这个距离短一些,保证数据信号短一些

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发表于 2024-4-3 14:02:45 | 显示全部楼层
其它的都做的挺好的
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发表于 2024-4-4 15:09:29 | 显示全部楼层
cesc 发表于 2024-4-3 14:02
以后做的时候,尽量这个距离短一些,保证数据信号短一些

好的,老师
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