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[作业已审核] 王杰-4片DDR3芯片布线设计

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fs_jay

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发表于 2024-6-5 16:28:31 | 显示全部楼层 |阅读模式

工业和信息化部教育与考试中心-电子工程师证书（PCB设计、硬件设计、嵌入式设计），认证报考通道→→点击立即报名

本帖最后由 cesc 于 2024-6-17 14:12 编辑

4片DDR3芯片布线设计

1、参考老师的教学视频，为了锻炼布线能力，选择较小尺寸的板布局布线。
2、拓扑选择T点布线。

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cesc

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发表于 2024-6-17 14:10:39 | 显示全部楼层

这个T点往下移动一些，横向走线就不会那么往上拱了
截图202406171410356585.png

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cesc

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发表于 2024-6-17 14:11:32 | 显示全部楼层

走线尽量满足3W间距

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cesc

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发表于 2024-6-17 14:12:29 | 显示全部楼层

不同组的信号，间距拉开一些。，能用地线隔开最好

截图202406171412128840.png

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cesc

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发表于 2024-6-17 14:12:37 | 显示全部楼层

其它问题不大

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fs_jay

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发表于 2024-6-18 19:23:54 | 显示全部楼层

好的，感谢老师的电平，辛苦了！

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