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[作业已审核] 23 楚子明的常用存储器设计-4片DDR3的PCB设计-(菊花链)

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发表于 2024-6-12 15:28:29 | 显示全部楼层 |阅读模式
VREF 管脚就近摆放
如果可以,管脚调换,CK【元器件关联】  
那么管脚调换操作,需要把旧器件表复制出来,在把新器件表复制出来。

23 楚子明的常用存储器设计-4片DDR3的PCB设计.zip

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发表于 2024-6-13 16:53:43 | 显示全部楼层
注意检查等长报错,所有线都进行等长

截图202406131653221841.png
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发表于 2024-6-13 16:54:48 | 显示全部楼层
注意跨分割
截图202406131654414690.png
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发表于 2024-6-13 17:11:51 | 显示全部楼层
两个焊盘一个过孔

截图202406131711384562.png
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