编号:20170828 PCB公益评审报告

PCBQA

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邮件格式：PCB公益评审+项目名称
邮件地址：pcbqa@fany-eda.com
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! E+ G" l$ D' P. f1 A7 {6 w" O1、走线间距太近、等长数据太近，容易引发串扰
7 m. _' o: ]) L# o+ g. y$ x- ~2 f
* {2 S, J7 V1 U" I6 X( m

PCBQA

2、电源模块连接太细，载流不够，


! ^6 a% j: B0 P十字连接是可以的，需要加粗处理，保证载流
, ^0 F, }, C1 b) {6 m' y# B& A# B, ]

* J( n+ s/ \" K

/ \, b8 [: Q) g  N7 M

PCBQA

问题3 电源走线载流不够 核心电源在表层bga中连接一根线，是不行的，很多地方存在瓶颈
. `/ z! b- G0 {6 n- b
; a' g. j. A7 u
5 ~; P+ U9 B: K处理意见： 查看电流大小，加大铺铜宽度，保证载流量
1 o# s2 Q1 P  @" D1 p/ u

PCBQA

电源分割有瓶颈、分割带不要有狭长的地带，

0 x7 _6 m; v( `, ?



9 t5 R% [* P8 @9 @) M分割掉20mil以上，分割出的区域尽量规，不要狭长的一条 载流都不够
( E, Q; G' a4 d9 o% Y

PCBQA

; h8 U4 a: R  T
DDR走线严重出现跨分割
, d- n7 O6 m9 `9 c/ k3 c3 X
DDR所有的走线都应该在ddr的电源分割区域内
1 M2 g4 I8 n6 e
1 a8 s/ S' F8 E) `& U) I& k6 K  C
! n7 z/ k4 L! t

PCBQA

时钟差分匹配有问题
* s+ u7 c: D- w# t- X  [' y0 `处理意见： 时钟经过串阻以后应该也是差分信号，请核查原理图是否正确


; d8 A6 V4 w, k$ c
( c: F- \! G$ i: ]

as3218710

很给力的资料，感谢楼主的分享。

veis

谢谢郑工评审

easegirl

很给力的资料，感谢楼主的分享。

lfly07

: L7 D3 V. E2 `1 L+ v& J很给力的资料，感谢楼主的分享。