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现象一：这板子的pcb设计要求不高，就用细一点的线，自动布吧; x0 j2 K3 D* X, K
点评：自动布线必然要占用更大的PCB面积，同时产生比手动布线多好多倍的过孔，在批量很大的产品中，PCB厂家降价所考虑的因素除了商务因素外，就是线宽和过孔数量，它们分别影响到PCB的成品率和钻头的消耗数量，节约了供应商的成本，也就给降价找到了理由。
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! z/ d) D" u8 D b j+ I# d, F6 P现象二：这些总线信号都用电阻拉一下，感觉放心些。
) q& [: ]4 z! \点评：信号需要上下拉的原因很多，但也不是个个都要拉。上下拉电阻拉一个单纯的输入信号，电流也就几十微安以下，但拉一个被驱动了的信号，其电流将 达毫安级，现在的系统常常是地址数据各32位，可能还有244/245隔离后的总线及其它信号，都上拉的话，几瓦的功耗就耗在这些电阻上了。* l: R; K# n; K0 W
6 ^: g- C' Z" x0 O S# A& l现象三：CPU和FPGA的这些不用的I/O口怎么处理呢？先让它空着吧，以后再说。5 ?4 r" t9 T3 E2 Q% F
点评：不用的I/O口如果悬空的话，受外界的一点点干扰就可能成为反复振荡的输入信号了，而MOS器件的功耗基本取决于门电路的翻转次数。如果把它上拉的话，每个引脚也会有微安级的电流，所以最好的办法是设成输出（当然外面不能接其它有驱动的信号）6 O. ^, u0 i! Z; O: r+ P
+ m+ Z, _+ `4 C. q5 B, L% K现象四：这款FPGA还剩这么多门用不完，可尽情发挥吧
/ q9 T% P" [1 ?# J8 i t点评：FGPA的功耗与被使用的触发器数量及其翻转次数成正比，所以同一型号的FPGA在不同电路不同时刻的功耗可能相差100倍。尽量减少高速翻转的触发器数量是降低FPGA功耗的根本方法。) _# y' Q/ y6 ]3 {( ~
# D, \! c1 z2 t# b现象五：这些小芯片的功耗都很低，不用考虑
" n3 l4 A% z0 w0 |# ^点评：对于内部不太复杂的芯片功耗是很难确定的，它主要由引脚上的电流确定，一个ABT16244，没有负载的话耗电大概不到1毫安，但它的指标是 每个脚可驱动60毫安的负载（如匹配几十欧姆的电阻），即满负荷的功耗最大可达60*16=960mA，当然只是电源电流这么大，热量都落到负载身上了。
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