编号:20170907 PCB公益评审报告

PCBQA

您阅读的评审报告自于凡亿PCB QA评审组(www.fany-online.com)
------------------------------------------------------------------------------------
" Z, z) Y6 @+ P) y! K使用前请您先阅读以下条款:
1.评审PCB全程保密不外发，评审之后会进行文件删除，介意者不要发送文档！
7 H! L7 }$ [% W$ E( B, W% X" x& H2.评审报告只是局部截图并添加文字说明，如需更详细的请内容请联系我们评审人员
3.评审意见仅供参考意见，由此造成的任何相关损失网站概不负责 。
------------------------------------------------------------------------------------
) ]2 L  o7 s  E  [如果您的PCB需要评审，请以邮件的方式发送给我们，我们一般在1个工作日之内安排评审
邮件格式：PCB公益评审+项目名称
" W: i/ n' n; g4 C6 j# o- o邮件地址：pcbqa@fany-eda.com
& x/ s: J( w; e9 M6 I' p! @3 T3 d------------------------------------------------------------------------------------
1、USB为供电管脚 电源输入主干道要加粗一般按照20mil过载1A电流进行评估，目前是开始时候大 但是后面变太小了不符合要求，表层过孔没起作用可以删掉

PCBQA

2、这类电源输入输出主干道分不清楚，造成走线、打孔出现问题，第一脚为输入  第5脚为输出  第3脚 只是一个使能信号脚 走线10mil就够了 不需要敷铜
7 }0 g1 u. r: g( `5 Z请优化输入和输出管脚 过载大电流的，其他几个不再一一指出 一样的 请先理清楚输入输出

PCBQA

3、滤波电容的放置 非常差，请靠近管脚进行放置，尽可能的近一些，走线先经过滤波电容滤波之后再进入IC管脚。
0 {8 W& p+ S. i6 s; f  U

PCBQA

4、SDRAM需要进行等长布线，走线间距不满足3W原则 走线太近 ，请严格按照SDRAM相关规范进行布局布线
5 h$ ~2 b5 f0 k2 {" X6 w7 z- P
6 Y9 ?/ Z- M2 v) C
2 w6 i6 R0 Z/ e2 |2 S. [3 v
. M& i9 y6 r- N& q* F

PCBQA

5、平面分割问题严重，存在过载通道太细，出现孤铜 无法载流的问题，这个板子通过这种分割 核心电源无法满足供电 板子跑步起来的
# e/ W' P2 k9 q# i3 j$ K
+ F1 O$ Q# X! S0 d$ t7 u
* D# a( Q  A1 V6 V$ i: G5 h5 B" n  m建议你看下凡亿PCB四层核心板的Demo的设计：https://item.taobao.com/item.htm ... cju&id=536934512329
% f, _  O+ C" ^) f; G/ x0 m很多问题 这个视频当中都有进行讲解

PCBQA

6、关于晶体的滤波方式 请采用π型滤波方式，电容放在前面，注意其他地方也类似检查


. L- y1 W/ d4 W2 `2 E
具体设计要求请参考以下内容：

布局要求：

1、布局整体紧凑，一般放置在主控的同一侧，靠近主控IC。

2、布局是尽量使电容分支要短（目的：减小寄生电容，）

3、晶振电路一般采用π型滤波形式，放置在晶振的前面。

布线要求：

1）走线采取类差分走线；

2）晶体走线需加粗处理：8-12mil，晶振按照普通单端阻抗线走线即可；

3）对信号采取包地处理，每隔50mil放置一个屏蔽地过孔。

4）晶体晶振本体下方所有层原则上不准许走线，特别是关键信号线。（晶体晶振为干扰源）。

5）不准许出现stub线头，防止天线效应，出现额外的干扰。

7、继电器为干扰源，请本体下面挖空处理。并且，走线需要加粗处理。

2 B/ ]% d: S6 M9 D/ ~5 w

PCBQA

7、走线 请考虑 GND的回流问题 考虑后期等长的空间 考虑阻抗及串扰等问题（3W），存在问题太多 建议此版进行重新设计

/ w' r; e2 L4 i) b* b% `

1625536570

非常给力的点评，避免出现类似问题

cesc

强烈支持PCB联盟网网友资料分享，免费资源就是给力！

bidinghong

非常给力的点评