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[文件已评审] 编号:20170920 PCB公益评审报告

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发表于 2017-9-20 10:11:00 | 显示全部楼层
11、LCD5V应该不够,请加粗到40mil以上& y7 ^- V/ `. g2 R' I

4 A. Q" |5 z% a& @, J% F" L  Y3 D  }, M, K( t3 _
- ^: l! P# f* v& {! J7 H' }1 M- M

8 D( m6 T' Z6 p/ @

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发表于 2017-9-20 10:11:33 | 显示全部楼层
12、USB如果用于供电,那么这里这么一根线肯定也是不够的。* L9 w% h  L6 Y* j4 K
  O% a- @) N  \2 E* S* ^0 B

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发表于 2017-9-20 10:13:18 | 显示全部楼层
13、DDR部分信号 要被DDR电源全部覆盖。
# Y0 W  u9 q  W7 v8 ^7 {

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发表于 2017-9-20 10:14:06 | 显示全部楼层
14、重新设置下规则,DDR电源都被割断了。
- ?$ H, M7 i9 b) |/ }
0 ?6 `+ g  ~3 W

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发表于 2017-9-20 10:14:57 | 显示全部楼层
15、LOG也是大电流,这样处理不行,载留面积根本够的。
9 B% j" G( I8 M) D: K# A

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发表于 2017-9-20 10:15:51 | 显示全部楼层
16、USB供电 太小了。
. Z; t& M4 Q" R
" T1 J  ?$ }' N- g7 Q% }) V

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发表于 2017-9-20 10:16:09 | 显示全部楼层
评审建议:3 M) b" n. I, c
1:重新设定规则,铜皮采用全连接,铜皮到过孔的距离设置为5/ f# f9 d8 _; a- f% w0 w- U
2:给予主控部分,电源部分分别加屏蔽罩。
- Y3 S0 Q' r; u1 Q  Q$ C. V3:修整电源,BGA出来的LDO加大,尤其是BGA的核心电源。3 F+ A1 u; s' z9 w8 \6 [: m; O: f
4:调整DDR数据线和地址线的环路,减少环路面积,压缩DDR范围。3 T: z. p( q- w' h0 W
5:压缩 DDR范围后,将垮入DDR部分的其他信号线及电源挪走。+ W1 Y' P+ k7 }1 c( l7 r) K) q
DDR部分不能有其他任何与DDR无关的信号,每层都是这样的。
7 c1 G/ E0 s( x+ k$ ?6:其他的一些问题等整改完后,在看。先把这些致命问题整改好。
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发表于 2017-9-20 17:15:41 | 显示全部楼层
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发表于 2017-9-21 14:13:40 | 显示全部楼层
/ k0 H3 J9 |4 f: A! N9 B
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发表于 2017-9-22 08:25:53 | 显示全部楼层
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