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[文件已评审] 编号:20170920 PCB公益评审报告

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发表于 2017-9-20 10:11:00 | 显示全部楼层
11、LCD5V应该不够,请加粗到40mil以上( y' Z9 S7 i) ~0 e. e8 |: J2 z0 E
( ?3 D  E0 l; A6 B- t- l

% q* a3 o5 l& P" ~; w) c! F

8 L7 ~) M* ?5 P& ~3 S3 |& m9 v$ H8 Z, T9 b* m4 G& C9 C& u

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发表于 2017-9-20 10:11:33 | 显示全部楼层
12、USB如果用于供电,那么这里这么一根线肯定也是不够的。
9 T) d* }6 L( j! a6 Q7 m; K0 u3 e8 j3 Z) V1 ?+ P

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发表于 2017-9-20 10:13:18 | 显示全部楼层
13、DDR部分信号 要被DDR电源全部覆盖。

) z, o+ G; l% E* b. U7 J6 b

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发表于 2017-9-20 10:14:06 | 显示全部楼层
14、重新设置下规则,DDR电源都被割断了。
# J2 {9 H1 x; n) Z6 l8 r# o- c; I- |

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发表于 2017-9-20 10:14:57 | 显示全部楼层
15、LOG也是大电流,这样处理不行,载留面积根本够的。

; |! R: z9 j4 |7 w+ d; m

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发表于 2017-9-20 10:15:51 | 显示全部楼层
16、USB供电 太小了。
& C# A% ]3 e1 D3 ^" b
* m( Y5 j5 b6 o6 V" q

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发表于 2017-9-20 10:16:09 | 显示全部楼层
评审建议:
% H7 P0 U) p+ Y: {1:重新设定规则,铜皮采用全连接,铜皮到过孔的距离设置为5
4 e# c, y1 O7 W( X$ h$ g- [9 |2:给予主控部分,电源部分分别加屏蔽罩。+ m) W$ C) k% a9 r( d2 A
3:修整电源,BGA出来的LDO加大,尤其是BGA的核心电源。; G( c0 d/ A0 n2 r/ v# q. N
4:调整DDR数据线和地址线的环路,减少环路面积,压缩DDR范围。. u8 U$ ~& ]; U( p; |
5:压缩 DDR范围后,将垮入DDR部分的其他信号线及电源挪走。. F/ n- Z7 S, |: x
DDR部分不能有其他任何与DDR无关的信号,每层都是这样的。) S' E1 l" B/ |6 }1 y
6:其他的一些问题等整改完后,在看。先把这些致命问题整改好。
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发表于 2017-9-20 17:15:41 | 显示全部楼层
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发表于 2017-9-21 14:13:40 | 显示全部楼层
8 \2 O0 [0 S" v2 Z
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发表于 2017-9-22 08:25:53 | 显示全部楼层
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