扇出型晶圆/面板级封装技术概述

逍遥设计自动化

引言
5 i, ?9 L! F- F$ n7 K9 j/ m6 K扇出型晶圆/面板级封装（FOW/PLP）是先进的封装技术，与传统封装方法相比，能够实现更高的I/O密度和更好的电性能。本文概述FOW/PLP技术，包括关键工艺步骤、应用和可靠性考虑因素。

扇出型封装简介
  k, c' R4 E3 ]扇出型封装与扇入型晶圆级芯片尺寸封装（WLCSPs）的不同之处在于它需要在加工过程中使用临时载体。这允许重布线层（RDLs）延伸到原始芯片边界之外，从而实现更高的I/O数量。
. ?# M& g$ S& F) m, A* |; i
- o- Q2 G. [/ u% ]) m8 I% `) C5 f如图1所示，扇出型封装的步骤包括：

将已知良好芯片（KGDs）拾取并放置在临时载体上

用模塑料封装芯片

在封装芯片上制作重布线层

贴装焊球

移除临时载体并将个别封装切割分离
" q: V) Y' K" B, T6 ~; d[/ol]
6 k4 W( J/ q  r, }; _

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$ {8 t1 y& Q$ R8 k: l  w- U图1
' ]7 |) N) r3 B
扇出型封装的主要优势包括：

更高的I/O密度

改善的电性能

更薄的封装厚度

异质集成多个芯片的能力

扇出型晶圆级封装工艺流程
典型的扇出型晶圆级封装（FOWLP）工艺流程包括以下关键步骤：
: f3 t% ^" M$ h; E4 F! |' c

晶圆准备和切割

芯片贴装到临时载体

模塑/封装

载体移除

重布线层制作

焊球贴装和切割分离
7 `& g$ U7 ]$ A0 h/ g) G: v
图2提供了芯片优先、正面朝下FOWLP方法的这些工艺步骤的视觉概览：

& b/ W  o* j; c% _1 S* \9 _

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# [" Q; }  V! E' u& P) v图2
4 h; V. o" D1 l0 `: f
; l. z5 C; z# O& A6 r8 U9 b) IFOWLP加工中的关键考虑因素包括：
3 M9 {# Q2 i5 ]( w0 ?7 x9 u. ~

临时载体选择（玻璃、硅、金属）

模塑料性质

重布线层制作（线宽/间距、通孔形成）

模塑过程中的芯片位移

翘曲控制
! J6 I9 [& d# ^& Z! c
扇出型面板级封装
" J4 G5 I1 g2 ~* N8 `7 [为了进一步提高产量并降低成本，扇出型加工可以扩展到大型矩形面板而不是圆形晶圆。这被称为扇出型面板级封装（FOPLP）。

图3展示了508 x 508 mm面板的例子，其中包含1512个扇出型封装：
5 S; J* m* R9 o

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$ P) H  B1 n8 U* I6 m* u图3
% h0 k' u! g$ r
/ h+ D8 T% [0 j2 X# b2 n$ N3 ^FOPLP的主要优势包括：
+ z6 A. W& [; I

更高的产量

更低的每个封装成本

利用PCB/显示器制造基础设施

然而，像翘曲控制和维持大面板上的均匀性等挑战必须得到解决。
. J+ C! B- F4 _
重布线层制作
6 M) t& d1 W' c扇出型封装的一个关键方面是细间距重布线层（RDLs）的制作。这通常涉及：

介电层沉积/图案化

种子层沉积

光刻胶图案化

铜电镀

种子层去除
3 t! m- a: z7 W[/ol]
图4显示了扇出型封装中10 μm线宽/间距RDLs的扫描电镜图像：

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5 r/ Z/ ^$ N0 U; F0 a6 d% x图4
先进的扇出型封装可能包含多个RDL层，线宽/间距尺寸可达到2/2 μm。
+ X8 m5 A; M9 `8 u. \/ l# Q
芯片后置与芯片优先方法
扇出型封装可以使用芯片优先或芯片后置（RDL优先）方法实现：
% e+ s, O: H1 v1.芯片优先：
) P; w8 i, L* C

在RDL制作之前将芯片贴装到载体上

成本更低，产量更高

更容易发生芯片位移
+ j% M  j! n) X9 ?3 a
5 K6 z; r2 W0 o$ W. s2.芯片后置：
- L4 u) x" G, p3 V& t" \

在芯片贴装之前在载体上制作RDLs

更好的尺寸控制

成本更高，工艺步骤更多

图5展示了RDL优先FOWLP方法的工艺流程：

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4 c6 d5 l# h4 ~/ i: Z* Q! s( @图5
- d, v8 Q9 i' B$ E9 {! w
芯片优先和芯片后置之间的选择取决于成本、尺寸控制要求和芯片尺寸/间距等因素。

& o( W) D! j9 H3 g# I# B6 c0 R3 B异质集成
& C3 @3 \+ r* U, [. `扇出型封装的一个主要优势是能够在单个封装中集成多种类型的芯片。这使得以下组件的异质集成成为可能：

逻辑 + 存储器

模拟 + 数字

处理器 + 传感器
2 m0 W& ?2 p6 K  M8 ?; s- n8 X6 A3 O
图6展示了一个集成多种芯片尺寸的异质扇出型封装示例：
, u' M# o% K$ L, c+ O- J7 {
+ V+ v6 s( Q( v$ B* ^9 m: w! d

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图6
2 ^8 ^" H3 D0 D- O; \1 g8 }1 Y
5 B# g! F: ~2 d6 c在异质扇出型设计中，必须仔细考虑芯片放置、RDL布线和热管理。
4 _. h3 ?4 L9 }
可靠性考虑
扇出型封装的主要可靠性问题包括：

模塑过程中的芯片位移

翘曲

RDL裂纹/剥离

焊点疲劳

湿敏度
; n- G2 d. d: w3 ~
% J# a5 {# [9 H' x可靠性测试通常包括：

温度循环

跌落/冲击测试

湿敏等级（MSL）测试
; l* J; v9 w# m" [" N2 L8 v) l
/ w( F; J& g" ?5 x" f! b6 P图7展示了温度循环后扇出型封装中的焊点裂纹示例：

2 j' S" q0 A$ {

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" G  W% w& `/ B9 d, W图7

7 s& Q& N8 ?$ h- O. _有限元建模通常用于分析应力和预测可靠性，如图8所示：

iwtkprskvil64034869442.png

  p& R2 V1 y1 m" v. S1 W' v图8

新兴应用：Mini-LED显示器
& m' @) P7 t( o4 W+ P" C扇出型封装的一个新兴应用是在mini-LED显示器中。扇出型封装允许超细间距集成mini-LED阵列。
: B. {8 C) }6 Z: c
图9展示了使用扇出型技术封装的mini-LED阵列示例：
# p0 N" Z# `( C: ~. t
4 X* h/ W& ?4 ?7 \8 Z- L4 m$ L

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# w/ `% M# m( e" m/ a( H图9
; u! z& D3 o7 L+ a# g
9 `8 Z# w( q! K; Q3 Tmini-LED封装的主要优势包括：
1 \) z; p) f* A* ^4 S; |4 b, h

超细间距能力（

改善的热性能

更低的封装厚度
1 I/ q  t- l+ d+ A7 z& k. u
图10展示了集成在扇出型封装中并安装在PCB上的mini-LEDs的横截面：
) D2 K7 Z) N2 O, F' B# P3 s

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" M( \, a: G9 ]9 R图10
6 t) x- r8 }* W( z: a$ i6 C2 I
总结
扇出型晶圆/面板级封装与传统封装相比，能够实现更高的I/O密度、改善的性能和异质集成。主要方面包括：
/ i2 C+ g- w/ x" z5 @

使用临时载体

RDL制作

芯片优先与芯片后置方法

扩展到面板级以提高产量

可靠性考虑
; B+ V8 b3 Q! E* A9 x7 y5 ], h
像mini-LED显示器这样的新兴应用展示了扇出型封装对下一代电子产品的优势。随着传统封装的缩放达到极限，预计扇出型技术将在先进电子系统中发挥越来越重要的作用。
9 X2 e1 X( U- c' q/ i
0 G5 X. _4 K+ p( B5 Q参考文献
[1] J. H. Lau, "Fan-Out Wafer/Panel-Level Packaging," in Semiconductor Advanced Packaging. Singapore: Springer Nature Singapore Pte Ltd., 2021, ch. 4, pp. 147-228.

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