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引言
8 B. O" X, g3 U& O9 Z, w9 M: n; h& @本文探讨AMD即将推出的"Zen 5"核心架构。这一新一代处理器核心在性能和效率方面都有显著提升,对于计算行业的发展具有重要意义。
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"Zen 5"核心概述8 w5 K9 @' ?3 Q! v
"Zen 5"核心是AMD成功的Zen架构系列中的最新迭代。在继承前代优势的基础上,"Zen 5"旨在提供显著的性能改进,同时保持出色的能效比。- t- N, Z+ t3 ]+ Z, B A5 c! B* \
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8 e! d/ _2 O, q! A, Q0 g! p+ a图1：展示了Zen架构的演进,突出显示了Zen 3、Zen 4和Zen 5的关键特性。( M) Q1 i$ [9 I; K' g7 ]8 T
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"Zen 5"的主要特性:相比"Zen 4"提升16%的IPC(每时钟周期指令数)支持AVX-512变体和FP-5128宽度指令分发和6个ALU(算术逻辑单元)双管线取指/解码采用4nm/3nm制程工艺
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! y! o# I8 x, U3 k1 X' D微架构深入分析
1 {3 A8 \4 A& u5 i* P+ r7 H& I"Zen 5"微架构引入了多项增强功能,以提高性能和效率。
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; e2 p9 g) b9 S7 [1 j图2：提供了"Zen 5"微架构的详细概览,展示了各个组件及其互连。" C) ~( M1 o& c# t8 d
& C8 w1 b! b- _0 e4 ?3 s. B前端改进:0 ~! F3 A O( g; A [
双指令取指和解码管线8宽度指令分发到整数或浮点单元增强的分支预测,每周期可进行2次预测更大的Op-Cache,可存储6K条指令,每周期2x6宽度取指
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% `5 H% k5 j6 f) |执行单元增强:3 X9 G1 C5 D! J# T& t/ \3 P; C
6个整数ALU和4个AGU(地址生成单元)每周期4个浮点运算,FADD(浮点加法)延迟为2周期完整的512位AVX-512数据通路,提高吞吐量
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缓存和内存子系统:
% T4 G2 P6 i; v2 \48KB 12路组相联L1数据缓存,每周期可进行4次读取,2次写入操作1MB 16路组相联L2缓存改进的L3缓存延迟8 ~4 k5 J' O! M$ K
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"Zen 5"家族和平台支持! j. ^1 u7 S* |0 W" L1 M% U1 x/ X
AMD推出了两种"Zen 5"核心变体,以满足不同市场细分的需求:"Zen 5":优化单线程性能"Zen 5c":注重性能功耗比和性能面积比
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图3：展示了"Zen 5"家族成员,显示了"Zen 5"和"Zen 5c"核心之间的差异。
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# E3 \, Q! S: n9 m& x" ]这种方法使AMD能够针对从高性能台式机到节能移动设备的广泛产品范围。
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新指令集架构(ISA)特性
7 ~5 Y, J* n5 h6 O3 m9 C"Zen 5"核心引入了几项新指令和功能:5 z9 H. ~4 @. _, x; V( E
MOVDIRI/MOVD64B：4、8或64字节的直接存储指令VP2INTERSECT[DQ]：AVX-512向量对交集3VNNI/VEX：带VEX编码的扩展AVX-512指令PREFETCH[I*]：指令线的软件预取增强的安全特性，包括SEV(安全加密虚拟化)改进
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性能提升
1 i) Z$ k1 Q' E5 eAMD声称"Zen 5"核心在各种应用和使用场景中都实现了显著的性能提升。
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图4：展示了"Zen 5"相比"Zen 4"的关键进步,突出显示了各个领域的改进。
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' H3 L5 G2 ?+ Y, Y* w, U- {4 A M9 mIPC提升4 z4 B ^0 X! S8 d2 ^6 D# [
"Zen 5"核心在一系列应用中展现了令人印象深刻的IPC改进:
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图5：显示了使用"Zen 5"核心的PC相比前几代产品的IPC提升。
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AI和科学计算1 N3 g8 o* G% n( I
"Zen 5"核心在AI和科学计算工作负载方面也表现出显著的性能提升:
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图6：展示了基于"Zen 5"核心的第5代AMD EPYC "Turin"处理器在AI吞吐量性能方面的领先地位。
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在SoC中的实现( S6 x) A4 k5 f+ u2 q
"Zen 5"核心将被实现在各种系统级芯片(SoC)设计中,以满足不同市场细分的需求。
. ?; |4 I+ ?; \( }* E! M"Strix Point" SoC:
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3 U! p. P! w+ f( p* ~图7提供了"Strix Point" SoC的详细框图,展示了"Zen 5"和"Zen 5c"核心的集成。
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"Strix Point"的主要特性:
2 L" l) ]5 O( P' A/ z8 k. g! F异构架构,包含4个"Zen 5"核心和8个"Zen 5c"核心集成RDNA 3.5图形处理器,最多16个计算单元XDNA 2推理引擎,用于AI加速支持DDR5/LPDDR5内存PCIe 4.0和USB4连接( X5 {0 k5 O4 v1 L4 E7 D
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"Granite Ridge" SoC
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9 a) q' I3 c1 D7 O0 n# c6 z/ p' J, J图8：显示了"Granite Ridge" SoC的框图,该SoC专为高性能台式机应用设计。
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"Granite Ridge"的主要特性:
- J& M4 P/ A1 W; k, ]0 W+ k- B; [最多16个"Zen 5"核心(2个CCD,每个8核)每个CCD 32MB L3缓存支持DDR5内存PCIe 5.0连接兼容AM5插槽& o4 ^# B4 w4 z
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能效改进$ w. Z. X* E# y) B
"Zen 5"核心在Zen系列的能效优势基础上进行了进一步改进:增强的电源门控技术改进的smt(同步多线程)支持,提高性能功耗比缩短电源状态进入/退出时间优化分支预测,减少无用工作高效的字符串操作和预取器改进
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8 s! W# ?. ~6 _. f4 d这些增强功能在保持出色能效的同时,提高了整体系统性能。
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RDNA 3.5图形架构
# T- G, e. u/ i! R对于移动应用,AMD还改进了集成图形架构,推出了RDNA 3.5:# V9 z( H. C( q1 Z
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5 X' A+ Q9 k+ B" I图9：概述了为移动应用优化的RDNA 3.5图形架构的改进。
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RDNA 3.5的主要改进:
# _1 d w; s5 P+ G3 j1 K' y2倍采样率和点采样加速增强的着色器子系统,插值和比较率提高2倍改进的光栅化子系统,通过子批处理提高效率针对LPDDR5的内存子系统优化和改进的压缩更大的引擎配置,包括8个WGP(工作组处理器)和4个RB+(渲染后端+). E* w+ s" F, y/ R) ~6 Z; G5 |8 {# Y5 m
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AMD Ryzen AI与XDNA 2架构( r) l. v+ _9 w% W0 M. L7 I
为了满足个人计算机对AI能力日益增长的需求,AMD引入了XDNA 2架构用于AI加速:: A+ q$ p: ^' y6 v9 Y
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( f( U& d- O8 ?' P图10：展示了基于XDNA 2架构的AMD Ryzen AI "Strix" NPU(神经处理单元)。# ^( T$ o: h! K0 H9 ?
' W" X m! z, w4 b" D( G" e0 O7 ^XDNA 2的主要特性:
/ Q! C! ?2 t2 y8 D+ z最高50 INT8 TOPS(每秒万亿次运算)和50 Block FP16 TFLOPS8个并发隔离空间流,提高多任务处理能力片上内存容量比上一代增加1.6倍支持块浮点和增强的非线性函数相比上一代产品,性能功耗比提高2倍3 _! w* @/ N4 i
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结论
" r) v# i& f, j' r# y8 C& R( d" KAMD "Zen 5"核心代表了x86处理器设计的飞跃,在各种应用中都提供了显著的性能改进。凭借对AI加速、能效和可扩展性的关注,"Zen 5"核心有能力满足从移动设备到高性能服务器等各种市场细分的现代计算需求。
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& F6 I1 s0 E$ O! V随着AMD不断创新和突破处理器设计的界限,可以期待未来会有更多令人兴奋的发展。"Zen 5"核心及其在各种SoC中的实现,展示了AMD在竞争激烈的处理器市场中提供领先性能和效率的承诺。: O! E) q$ [1 @3 p$ ?
7 L; ~4 L# d1 M: c, F参考文献9 K7 @0 y! I- t! z
[1] B. Cohen and M. Subramony, "Next Generation 'Zen 5' Core," in Hot Chips 2024, Aug. 2024.
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" \! S4 R5 q! x4 Q关于我们：: f0 C, D0 Q" K( \! H- P, B
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