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[作业已审核] SDRAM模块作业---冯凯

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发表于 2024-9-28 10:05:31 | 显示全部楼层 |阅读模式
工业和信息化部教育与考试中心-电子工程师证书（PCB设计、硬件设计、嵌入式设计），认证报考通道→→点击立即报名
SDRAM模块布局时采用点对点布局模式，尽量靠近BGA摆放，当两个器件中间无排阻是，摆放间距在600-800mil，有排阻时间距在800-1000mil，滤波电容靠近IC管脚摆放，走线阻抗控制在50om，数据线每9根尽量走在同一层D0-D7,LDQM;D8-D15,HDQM。信号线之间满足3W规则，数据线和时钟线、地址线之间满足20mil以上，空间足够情况下，用地线隔离开，加过地孔。高低8位数据线保持等长，误差在100mil，控制线，时钟线和地址线误差在200mil，如果原理图有特殊标注，走线应满足要求。走线后在走线中间空余处打上过地孔减少干扰。

SDRAM作业.PcbDoc

3.05 MB, 下载次数: 2, 下载积分: 联盟币 -5

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发表于 2024-9-30 14:52:23 | 显示全部楼层
bga器件内部过孔不要开窗处理，避免连锡短路
截图202409301452092910.png
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发表于 2024-9-30 14:53:43 | 显示全部楼层
数据线与地址线保持距离

截图202409301453268985.png
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发表于 2024-9-30 14:56:38 | 显示全部楼层
规范绕等长
截图202409301456287937.png
840D54A3-0836-43eb-9D54-526F3C051941.png
74268ca462517da5d29f23cd9c92ddcd.png
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