【芯片验证】异步电路碎碎念（十三）多比特跨时钟同步器的仿真

上一篇尝试构建了基于静态随机函数的单比特跨时钟同步器并进行了简单的仿真，这一篇实现一下本系列文章的最终目的 —— 多比特跨时钟域的仿真模块。其实在单比特的模块完成后，本篇的多比特同步器就比较简单了，只需要对单比特模块进行封装：

module multi_bit_async #(  //parameter  parameter WD = 4)( /*AUTOARG*/   // Outputs   o_data,   // Inputs   i_clk, i_rst_n, i_data, o_clk, o_rst_n   );
// ----------------------------------------------------------------// Interface declare// ----------------------------------------------------------------input          i_clk;input          i_rst_n;input [WD -1:0]i_data;
input          o_clk;input          o_rst_n;output[WD -1:0]o_data;
genvar i;generate  for(i=0; i1)begin: MULTI_OSYNC    bit_async    u_bit_async(      .i_clk    (i_clk),      .i_rst_n  (i_rst_n),      .i_data   (i_data),      .o_clk    (o_clk),      .o_rst_n  (o_rst_n),      .o_data   (o_data)    );  endendgenerate全部代码就完成了，而后进行下简单的测试。先来“试错”所以把顺序增长计数器送进去看看，快打慢的场景是这样的：

慢打快：

从这两个图可以清晰的看出来，异步FIFO里如果使用普通的计数器通过多比特同步器同步确实会造成指针逻辑判断错误。
接下来换成格雷码跨异步的测试：

以及慢打快，都没有发生异常的计数值传递：


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