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[作业已审核] 吕鸿飞-USB模块PCB设计作业

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lvhongfei

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发表于 2025-2-24 12:54:07 | 显示全部楼层 |阅读模式
工业和信息化部教育与考试中心-电子工程师证书（PCB设计、硬件设计、嵌入式设计），认证报考通道→→点击立即报名
信号走线有点长了，下次注意。

吕鸿飞-USB模块PCB设计作业.docx

18.71 KB, 下载次数: 0, 下载积分: 联盟币 -5

USB_2.0_PCB设计.PcbDoc

447 KB, 下载次数: 2, 下载积分: 联盟币 -5

USB3.0_TypeC模块PCB设计.PcbDoc

1.29 MB, 下载次数: 2, 下载积分: 联盟币 -5

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发表于 2025-2-25 10:48:55 | 显示全部楼层
过孔重叠无法**生产，而且割裂平面
截图202502251048362764.png
95797717-5979-4a9a-8D07-3A7C3995FE86.png
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发表于 2025-2-25 13:41:58 | 显示全部楼层
底层没铺铜
截图202502251341526154.png
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发表于 2025-2-25 14:09:37 | 显示全部楼层
Type-c这对差分线对内等长误差较大，需要调整

截图202502251409267597.png
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发表于 2025-2-25 14:15:48 | 显示全部楼层
Type-c这对差分线对内等长误差较大，需要调整



截图202502251415412398.png
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发表于 2025-2-25 14:21:45 | 显示全部楼层
USB2.0/USB3.0和Type-c，差分线不需要对间等长，但对内误差不得超过5mil，以下需要调整
截图202502251420035314.png
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发表于 2025-2-25 14:27:52 | 显示全部楼层
器件通孔管脚，在中间层相互干涉的问题，点击管脚，在右侧点选******即可解决
截图202502251427385507.jpg
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发表于 2025-2-25 14:33:47 | 显示全部楼层
器件通孔管脚在中间层相互干涉的问题，可以选中管脚，然后在右侧点选******即可解决
截图202502251433439429.jpg
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发表于 2025-2-25 14:42:01 | 显示全部楼层
未连接信号线
截图202502251441578993.png
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发表于 2025-2-25 14:46:06 | 显示全部楼层
项目完成，除负片层均要铺铜
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