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[作业已审核] 吴文露四层板DM642 pcb设计作业

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吴文露

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发表于 2025-3-5 14:57:37 | 显示全部楼层 |阅读模式
工业和信息化部教育与考试中心-电子工程师证书（PCB设计、硬件设计、嵌入式设计），认证报考通道→→点击立即报名
内缩外扩，快捷键DK，打开层管理，gnd 20,mil  电源60，il
晶体是干扰源包地处理 下方尽量不走线
网口变压器下方挖空处理，gnd 电源也需要挖空  
电源分割10-15mil  ，sdr走线不要跨分割
bga出现，可采用挪孔 并孔方式
sdr数据线严格遵循3w原则，误差100mil  控制线地址线时钟线可以2.5w 2w，误差200mil
xsignal创立，如u1-u2，先建立类，再创建xsignal。再创建规则

DM642达芬奇开发板4层.zip

6.33 MB, 下载次数: 2, 下载积分: 联盟币 -5

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发表于 2025-3-6 10:37:23 | 显示全部楼层
电感下方同层铜皮挖空处理
截图202503061037138096.png
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发表于 2025-3-6 10:39:15 | 显示全部楼层
晶振下方避免走线
截图202503061039018111.png
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发表于 2025-3-6 10:41:29 | 显示全部楼层
打孔换层处就近添加回流地过孔
截图202503061041186712.png
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发表于 2025-3-6 10:42:33 | 显示全部楼层
焊盘不要随便修改

变压器下方尽量避免走线
截图202503061042137327.png
截图202503061042066359.png
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