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[作业已审核] 刘云豪-四片ddr模块PCB布局布线设计

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发表于 2025-4-13 14:51:52 | 显示全部楼层 |阅读模式
工业和信息化部教育与考试中心-电子工程师证书（PCB设计、硬件设计、嵌入式设计），认证报考通道→→点击立即报名
1、特性阻抗:单端50欧,差分100欧
2、数据线每10根尽量走在同一层(D0~D7,LDM,LDQS),(D8~D15,UDM,UDQS )
3、信号线的间距满足3W原则，数据线、地址（控制）线、时钟线之间的距离保持20mil以上或至少3W
4、空间允许的情况下,应该在它们走线之间加一根地线进行隔离。地线宽度推荐为15-30mil

5、DDRx4和DDRx8时，一般两两正反对贴，同层放置时将导致远端分支过长


刘云豪第二十三次作业四篇ddrpcb布局布线设计.zip

1.39 MB, 下载次数: 1, 下载积分: 联盟币 -5

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发表于 2025-4-16 15:30:25 | 显示全部楼层
两组地址线重复Class

截图202504161435122821.png
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发表于 2025-4-16 15:44:31 | 显示全部楼层
ZQ线是阻抗匹配（ODT）的校准参考，属于模拟信号，布线要尽量短，且要加粗处理

所以ZQ线不需要等长



截图202504161531012455.png

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发表于 2025-4-16 15:50:41 | 显示全部楼层
不满足对内等长要求

截图202504161550368247.png
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发表于 2025-4-16 15:56:39 | 显示全部楼层
Xsignal只创建了U1-U2，U2-U3



没有U3-U4，U4-U5的规则

截图202504161553304249.png

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发表于 2025-4-16 16:00:47 | 显示全部楼层
差分线对内等长用小波形处理时，要满足要求

截图202504161559401659.png

截图202504161600257682.png

截图202504161600422101.jpg


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发表于 2025-4-16 16:22:54 | 显示全部楼层
间距不满足3W

截图202504161620562703.png
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发表于 2025-4-16 16:45:28 | 显示全部楼层
滤波电容尽可能靠近电源管脚摆放，且电容的GND网路与GND平面连接，就近回流

截图202504161642189720.png
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