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[文件已评审] 编号:20180428-3:公益评审

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发表于 2018-4-28 14:56:29 | 显示全部楼层 |阅读模式
您阅读的评审报告自于凡亿PCB QA评审组(www.fany-online.com)
, W+ R. [  l% |6 j8 L3 X3 o% h------------------------------------------------------------------------------------/ `6 K! V8 J3 V" x
使用前请您先阅读以下条款:
3 ^6 u/ y7 X  s- z6 T1.评审PCB全程保密不外发,评审之后会进行文件删除,介意者不要发送文档!6 x& X+ L. q$ A- X3 p4 r
2.评审报告只是局部截图并添加文字说明,如需更详细的请内容请联系我们评审人员1 _' t, i3 g# p2 @3 @0 p( ]% E
3.评审意见仅供参考意见,由此造成的任何相关损失网站概不负责 。# Z9 v0 T9 c% e  G
------------------------------------------------------------------------------------
- f& i$ \8 l& k+ V: S! R如果您的PCB需要评审,请以邮件的方式发送给我们,我们一般在1个工作日之内安排评审
9 @: m8 K' V6 q: I邮件格式:PCB公益评审+项目名称9 d* e! a2 c) O( j- G
邮件地址:pcbqa@fany-eda.com8 F( t; p- z: l9 H8 ^
------------------------------------------------------------------------------------
) C9 M  v5 T5 R' l5 ^- m" t4 b1.过孔未盖油6 r, A+ T" t$ S( |

/ G8 u; [1 o5 {/ m4 G, |

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发表于 2018-4-28 14:59:09 | 显示全部楼层
2.晶振部分尽量靠近IC,底部不可穿其他信号线,先经电阻,再到电容,π型滤波,且其周围要打满地孔" e  ^- G3 B0 F6 B
1 `, S+ R' M: `

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发表于 2018-4-28 15:00:45 | 显示全部楼层
3.液晶屏显示,整组包地并一起走,且时钟需单独包地# Y1 {2 H8 x7 V& a* X; S  `
7 Z* P) Q$ z$ }9 R8 F7 J- b

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发表于 2018-4-28 15:02:38 | 显示全部楼层
本帖最后由 凡亿pcb王工 于 2018-4-28 15:30 编辑 + [( G% j/ o* o" Z- \, i
6 e/ _1 u6 L! I7 F/ B
4.TF卡时钟包地处理
% `" M- i  y6 ], Z9 J2 @) C; `8 ~, l) z" F. v

; K* Q% s* ?6 g9 U# T5 }6 F; \' E

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发表于 2018-4-28 15:03:37 | 显示全部楼层
5.器件中间严禁穿线& V0 ~# k# C% z' t, T5 ^
+ ^3 P  ]3 B  P! F

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发表于 2018-4-28 15:10:42 | 显示全部楼层
6.WiFi模块处理不当,下面区域挖空处理,器件摆放散乱
' y  k/ M: y6 P, _" T& h/ C8 ^7 V4 Q+ r

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发表于 2018-4-28 15:13:55 | 显示全部楼层
7.走线直角; ~$ `: A% D* }
: G/ ^# @" r  |

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发表于 2018-4-28 15:19:32 | 显示全部楼层
8.走线太靠板边
1 R/ }9 m* d1 e6 O& G& F% \0 ^: \) `! M. Q1 E: {

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发表于 2018-4-28 15:20:42 | 显示全部楼层
9.明显的DRC错误
4 M: C, y( Q1 }' p  S' l6 I' L3 C* ?# q% r: X

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发表于 2018-4-28 15:22:34 | 显示全部楼层
10.回路过多
" A: S! u2 n" U# N8 ~
6 e* s4 `% e0 u/ f

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